Post sintēzes simulācijas

G

gck

Guest
Pls man pastāstīt, kā to izdarīt pēc sintēzes simulācijas izmantojot EDN failu Paldies jau iepriekš.
 
EDN fails tiek izmantots, lai vieta un maršrutu. Lai to izdarītu pastu sintēzi simulācijas, Jums nepieciešams konfigurēt sintezators ar rezultātu VHDL vai Verilog fails, kuru varat izmantot tieši jūsu testbench.
 

Welcome to EDABoard.com

Sponsor

Back
Top